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SMC主机接口模块设计导入Xilinx环境 来源:网络整理•作者:技术编辑archive1• 2017-11-18 10:15 • 次阅读 • 个评论

SMC主机接口模块可轻松将通过Synphony模型编译器创建的设计集成在赛灵思嵌入式平台中。

Synphony模型编译器(SMC)是一款Synphony提供的、基于模型的工具,其可综合在Simulink®及MATLAB®中创建的设计,从而可为ASIC和FPGA目标应用生成优化的RTL。SMC包含一个综合而全面的高级模型库,可在Simulink环境中创建数学、信号处理及通信设计。该库可在高级模型设计环境中简化定浮点单速率或多速率算法的捕获及功能调试。SMC RTL生成引擎可使用这些经过验证的模型自动创建RTL,为占位面积、性能、功耗以及吞吐量利弊权衡实现多架构的硬件实施及快速探索。SMC的高级综合引擎采用顶级设计以及MATLAB语言输入,可生成针对所选硬件目标而优化的RTL。此外,SMC还可针对设计自动生成一个RTL测试平台,并配以比特及周期高精度的C模型与SystemC封装程序,可在SystemC仿真环境中实现对所生成硬件的验证。

在许多应用中,设计人员通过创建外设来执行一些信号处理功能,并必须通过主机处理器(例如赛灵思 MicroBlaze™软处理器内核)来配置该外设。主机处理器通常采用标准总线接口(例如AMBA® AXI4或AXI4-Lite)连接外设。SMC库包括主机接口模块,其可来实现主机处理器的从接口。该主机接口模块不仅支持AXI4-Lite、APB、通用接口以及Avalon-MM总线接口协议标准,而且还可通过实现必要的内存映射的寄存器来配置SMC设计,其中包括FIR滤波器系数、数控振荡器(NCO)的频率与相位设置以及各种长度FFT模块的FFT长度。此外,该主机接口模块在实现内存映射的控制寄存器时可以采用任意需要的采样频率,可以与总线接口时钟异步。您可在主机接口模块的UI中指定总线接口及存储器映射设置。设计人员可使用主机接口模块将SMC设计连接至总线互联或者总线主控。

现在我们来详细了解一下,如何将通过SMC主机接口模块设计的外设导入并集成到赛灵思嵌入式开发套件(EDK)项目中。此外,我们还将考证如何仿真通过标准总线互连连接的从MicroBlaze主机处理器到外设的AXI4-Lite总线的数据传输。该过程有四个主要步骤:
1. 使用IP、主机接口模块以及SMC RTL生成引擎在Simulink中创建外设,为设计生成优化的RTL实施方案;
2. 将该外设导入赛灵思EDK工程,并将其与余下的设计集成;
3. 在SDK中开发软件应用;
4. 生成RTL并对其进行仿真,以检查软硬件功能是否正确。

面中选择外设的AXI4-Lite端口,并将其映射到标准AXI4-Lite端口上,以便EDK能够连接总线接口。如果SMC模型中定义的总线接口端口名称与标准总线端口名称相匹配,则EDK将自动映射端口(参见图4)。

如果端口名称不匹配,则可能要覆盖自动映射,如AXI4-Lite时钟(Clk-Div3)和复位(GlobalReset)信号所示。

然后,按照面中要保持RTL参数的默认属性不变,以确保与主机接口模块中指定的参数一致。

下个页面的标题为“端口属性”。在这里,您必须指定时钟属性,或者所有其它时钟上的复位或设计中的复位。请点击下个页面中的“完成”,添加外设至XPS项目。SMC外设现已成功导入XPS。您可通过查看
/pcores文件夹(XPS使用外设名称在此创建一个目录)验证是否成功。浏览该目录,检查RTL文件是否正确导入。

此外,XPS还将创建一个与HDL目录并列的目录,名为“数据”。该数据目录包含微处理器外设描述(*.mpd)文件以及相关外设参数及其端口信息。查看SIGIS = CLK和SIGIS = RST参数是否已在时钟及复位端口上定义。如果没有定义,则需要编辑*.mpd文件并手动添加定义。图5是添加了这些参数的文件实例。


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